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WEISS Jacques : Professeur SUPELEC, Campus de Rennes Contact : (Prenom.Nom at supelec.fr)
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bidon.bdf : schéma, origine du Projet (éditable) Compteur.bsf : symbole utilisé dans le schéma ; généré à partir du fichier VHDL decode_7seg.bsf : symbole utilisé dans le schéma ; généré à partir du fichier VHDL RAM_Program.bsf : symbole utilisé dans le schéma ; généré à partir du Megawizard bidon.vhd : Sommet du projet (Top-Level); généré automatiquement (non-éditable) Compteur.vhd : fichier VHDL de description decode_7seg.vhd : fichier VHDL de description RAM_Program.vhd : fichier VHDL de description ; généré à partir du Megawizard (non-éditable) RAM_Program.qip : descrition de l'IP RAM_Program ; généré à partir du Megawizard prog_bidon.mif : Fichier d'initialisation de RAM_Program (éditable) Projet_Bidon.tcl : script TCL de paramétrage du projet bidon.sdc : script de paramétrage de l'analyse temporelle (TimeQuest) Test_Bidon.stp : configuration de l'analyse logique (SignalTap) simulation/modelsim/ bidon.do : script DO deconfiguration de ModelSim bidon_vhdl_tst.vhd : Test bench pour la simulation (éditable)
Mise à jour : le 07/11/2011 11:37